AS4C1G32MD4V-046BIN

Alliance Memory
913-AS4C1G32MD4046BI
AS4C1G32MD4V-046BIN

Fabricante:

Descripción:
DRAM LPDDR4X, 32Gb, 1G X 32, 0.6v, 200ball TFBGA, 2133MHZ,industrial Temp

Ciclo de vida:
Nuevo producto:
Lo nuevo de este fabricante.
Modelo ECAD:
Descargue Library Loader gratis para convertir este archivo para su herramienta ECAD. Conozca más sobre el modelo ECAD.

En existencias: 257

Existencias:
257 Se puede enviar inmediatamente
Plazo de entrega de fábrica:
52 Semanas Tiempo estimado de producción de fábrica para cantidades superiores a las que se muestran.
Mínimo: 1   Múltiples: 1
Precio unitario:
$-.--
Precio ext.:
$-.--
Est. Tarifa:
El envío de este producto es GRATUITO

Precio (USD)

Cantidad Precio unitario
Precio ext.
$295.96 $295.96
$272.53 $2,725.30
$263.46 $6,586.50
$260.00 $13,000.00

Atributo del producto Valor de atributo Seleccionar atributo
Alliance Memory
Categoría de producto: DRAM
RoHS:  
SDRAM - LPDDR4X
32 Gbit
32 bit
2.133 GHz
FBGA-200
1 G x 32
10 ns
1.7 V
1.95 V
- 40 C
+ 95 C
AS4C
Tray
Marca: Alliance Memory
Estilo de montaje: SMD/SMT
Tipo de producto: DRAM
Cantidad de empaque de fábrica: 120
Subcategoría: Memory & Data Storage
Productos encontrados:
Para mostrar productos similares, seleccione al menos una casilla de verificación
Seleccione al menos una de las casillas de verificación anteriores para mostrar productos similares en esta categoría.
Atributos seleccionados: 0

Esta funcionalidad requiere que JavaScript esté habilitado.

MXHTS:
8542320299
CAHTS:
8542320020
USHTS:
8542320036
ECCN:
EAR99

2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM

Alliance Memory 2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM is organized as 1 or 2 channels per device, and the individual channel is 8-banks and 16-bits. This product uses a double-data-rate architecture to achieve high-speed operation. The double data rate architecture is a 16n prefetch architecture with an interface. It's designed to transfer two data words per clock cycle at the I/O pins. These devices offer fully synchronous operations referenced to the rising and falling edges of the clock. The data paths are internally pipelined and 16n bits prefetched to achieve very high bandwidth.